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TMS320DM642AZDKA6 库存 & 价格

TI DSP Fixed-Point 32Bit 600MHz 4800MIPS 548Pin FCBGA
￥ 644.27
TMS320DM642AZDKA6
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TMS320DM642AZDKA6 TI
TI
  • 制造商:
    TI
  • 制造商型号#:
    TMS320DM642AZDKA6
  • 百芯编号#:
    CM32525171
  • 价格(CNY):
    ￥
    644.27
  • 百芯库存:
    222 个
  • 可供应量:
    129 个在库
    此为供应商库存，需要与销售确认
  • 产品类别:
    DSP,数字信号,处理器
  • 产品描述:
    DSP Fixed-Point 32Bit 600MHz 4800MIPS 548Pin FCBGA
  • 文档:
    数据手册
    3D模型
TMS320DM642AZDKA6 购买 TMS320DM642AZDKA6 库存和价格更新于 2024-08-10 03:50:22
  • 刷新
    器件型号: TMS320DM642AZDKA6
    百芯编号: CM32525171
    制造商: TI
    封装: FCBGA-548
    价格
    ￥
    644.27
    总计: 351 个
    MOQ: 1
    库存地点: 香港
    发货日期: 2024/08/15 (预期 )
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    制造商
    TI
    类别
    DSP,数字信号,处理器
    3D模型
     3D模型
    安装方式
    Surface Mount
    引脚数
    548 Pin
    封装
    FCBGA-548
    频率
    600 MHz
    电源电压(DC)
    3.14V (min)
    时钟频率
    720 MHz
    RAM大小
    160 KB
    位数
    64 Bit
    工作温度(Max)
    105 ℃
    工作温度(Min)
    -40 ℃
    显示相似产品
    TMS320DM642AZDKA6 数据规格书
    TMS320DM642AZDKA6 数据手册Datasheet
    176 Pages, 1529 KB
    2012/03/28
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    TMS320DM642AZDKA6 数据手册Datasheet
    178 Pages, 1258 KB
    查看
    TMS320DM642AZDKA6 数据手册Datasheet
    177 Pages, 1325 KB
    2021/01/13
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    TMS320DM642AZDKA6 产品设计参考
    178 Pages, 1254 KB
    2017/04/17
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    TMS320DM642AZDKA6 产品设计参考
    178 Pages, 1258 KB
    2015/10/09
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    TMS320DM642AZDKA6 产品设计参考
    178 Pages, 1261 KB
    2015/09/30
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    TMS320DM642AZDKA6 产品设计参考
    176 Pages, 1597 KB
    2008/02/02
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    TMS320DM642AZDKA6 其它数据手册Datasheet
    88 Pages, 1289 KB
    2004/12/02
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    TMS320DM642AZDKA6 其它数据手册Datasheet
    4 Pages, 261 KB
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    尺寸 & 包装
    类型
    描述
    工作温度
    -40℃ ~ 105℃
    产品生命周期
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    Tray
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    类型
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    RoHS标准
    Non-Compliant
    含铅标准
    Contains Lead
    TMS320DM642AZDKA6 数据手册 >
    出口分类
    类型
    描述
    ECCN代码
    3A991.a.2
    TMS320DM642AZDKA6 数据手册 >
    产品概述
    • * High-Performance Digital Media Processor (TMS320DM642) * 2-, 1.67-, 1.39-ns Instruction Cycle Time * 500-, 600-, 720-MHz Clock Rate * Eight 32-Bit Instructions/Cycle * 4000, 4800, 5760 MIPS * Fully Software-Compatible With C64x™ * VelociTI.2™ Extensions to VelociTI™ Advanced Very-Long-Instruction-Word VLIW) TMS320C64x™ DSP Core * Eight Highly Independent Functional Units With VelociTI.2™ Extensions: * Six ALUs (32-/40-Bit), Each Supports Single 32-Bit, Dual 16-Bit, or Quad 8-Bit Arithmetic per Clock Cycle * Two Multipliers Support Four 16 x 16-Bit Multiplies (32-Bit Results) per Clock Cycle or Eight 8 x 8-Bit Multiplies (16-Bit Results) per Clock Cycle * Load-Store Architecture With Non-Aligned Support * 64 32-Bit General-Purpose Registers * Instruction Packing Reduces Code Size * All Instructions Conditional * Instruction Set Features * Byte-Addressable (8-/16-/32-/64-Bit Data) * 8-Bit Overflow Protection * Bit-Field Extract, Set, Clear * Normalization, Saturation, Bit-Counting * VelociTI.2™ Increased Orthogonality * L1/L2 Memory Architecture * 128K-Bit (16K-Byte) L1P Program Cache (Direct Mapped) * 128K-Bit (16K-Byte) L1D Data Cache (2-Way Set-Associative) * 2M-Bit (256K-Byte) L2 Unified Mapped RAM/Cache (Flexible RAM/Cache Allocation) * Endianess: Little Endian, Big Endian * 64-Bit External Memory Interface (EMIF) * Glueless Interface to Asynchronous Memories (SRAM and EPROM) and Synchronous Memories (SDRAM, SBSRAM, ZBT SRAM, and FIFO) * 1024M-Byte Total Addressable External Memory Space * Enhanced Direct-Memory-Access (EDMA) Controller (64 Independent Channels) * 10/100 Mb/s Ethernet MAC (EMAC) * IEEE 802.3 Compliant * Media Independent Interface (MII) * 8 Independent Transmit (TX) Channels and 1 Receive (RX) Channel * Management Data Input/Output (MDIO) * Three Configurable Video Ports * Providing a Glueless I/F to Common Video Decoder and Encoder Devices * Supports Multiple Resolutions and Video Standards * VCXO Interpolated Control Port (VIC) * Supports Audio/Video Synchronization * Host-Port Interface (HPI) [32-/16-Bit] * 32-Bit/66-MHz, 3.3-V Peripheral Component Interconnect (PCI) Master/Slave Interface Conforms to PCI Specification 2.2 * Multichannel Audio Serial Port (McASP) * Eight Serial Data Pins * Wide Variety of I2S and Similar Bit Stream Format * Integrated Digital Audio I/F Transmitter Supports S/PDIF, IEC60958-1, AES-3, CP-430 Formats * Inter-Integrated Circuit (I2C) Bus™ * Two Multichannel Buffered Serial Ports * Three 32-Bit General-Purpose Timers * Sixteen General-Purpose I/O (GPIO) Pins * Flexible PLL Clock Generator * IEEE-1149.1 (JTAG) Boundary-Scan-Compatible * 548-Pin Ball Grid Array (BGA) Package (GDK and ZDK Suffixes), 0.8-mm Ball Pitch * 548-Pin Ball Grid Array (BGA) Package (GNZ and ZNZ Suffixes), 1.0-mm Ball Pitch * 0.13-µm/6-Level Cu Metal Process (CMOS) * 3.3-V I/O, 1.2-V Internal (-500) * 3.3-V I/O, 1.4-V Internal (A-500, A-600, -600, -720)
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    百芯智造认证

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      - 2000㎡数码元器件仓库，恒温恒湿
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